fpga中有多少个乘法器，特权同学fpga设计1616乘法器的一个问题

来源：整理时间：2023-02-04 01:37:37 编辑：亚灵电子网手机版

1，特权同学fpga设计1616乘法器的一个问题

搜一下：特权同学fpga设计16*16乘法器的一个问题

[31:16]才是16位好么。[1:0]是2位的，你再算算吧你写的yout_r[31:15]是一个17位宽的了

特权同学fpga设计1616乘法器的一个问题

2，verilog booth算法 8位乘法器求助

如果是乘以2的倍数，则可以简单地通过移位来实现

你用的什么综合器？fpga还是dc？综合工具优化的当然会比你设计的要好，这是毋庸置疑的兄弟。是否冗余你可以按照最原始的方法（移位加）设计一个乘法器，对比综合结果。

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3，verilog乘法器源程序不懂求助

你这是没搞清笔算乘法的原理。verilog实现很简单主要是乘法原理解析那里：乘数某位1，本次运算就是累加一次被乘数后移位等待更高位计算，乘数某位0，直接移位等高位。在最高位时，不移位，直接累加。

谁做过verilog定点乘法器求源程序 [汇编语言]. 快速回答已回答很多数据，每一个数据平方后相加求和 [数据库] 有的程序在手机上经常显示无响应是 [编程开发].

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4，赛灵思的FPGA哪一款有很多的硬件乘法器

S6 最大的一颗 150 有 180个DSP。可以用V6 或者 k7 。也可以用 altera 的 c5

有多种方式，可以直接在硬件描述语言中使用乘法号*，编译环境会自动根据你选用的fpga芯片调用相应的硬件乘法器资源。或者还可以直接调用ip core的乘法器模块，设置相应的参数以及面积速度优化等即可。通常情况下，为了程序在不同fpga芯片上的移植方便，和专用乘法器的设计，考虑到fpga的资源一般还算丰富的条件下，自己编写乘法器模块。

5，verilog实现乘法器

如果是verilog要实现乘法,直接用 C = A * B; 就可以了.这样,在综合时软件会根据约束选择合适的电路结构.从你问题中判断你是想知道怎样用具体的电路构成乘法器. 你可以先将电路构成出来,然后用verilog表现. 这个一般比较少用,失去了采用verilog的意义.直接用电路网表表示就好了,何必掺合verilog进来.

6，FPGA中如何利用其中的乘法器

可以用开发工具里面带的IP，调出元件进行进行连接就可以用了。或者用例化语句应用。用语言调用可用下面的语句Library UNISIM;use UNISIM.vcomponents.all;-- <-----Cut code below this line and paste into the architecture body----> -- MULT18X18: 18 x 18 signed asynchronous multiplier -- Virtex-II/II-Pro, Spartan-3 -- Xilinx HDL Language Template version 6.3i MULT18X18_inst : MULT18X18 port map ( P => P, -- 36-bit multiplier output A => A, -- 18-bit multiplier input B => B -- 18-bit multiplier input ); -- End of MULT18X18_inst instantiation

7，fpga中乘法器位宽怎么确定

1、理论上大于10m就ok了，但是实际中肯定要留有余量的，40m可以，主要看你的主频能做到多少了。2、不管是正数还是负数，在FPGA中最好都用补码表示。3、截位当然是截断最低的位，高位截断了数据就错了。还有问题就是你这样做肯定只能用并行的方法来做了，因为你用大于10m的采样频率，如果你用10阶的FIR滤波器，同时需要9个乘法器，不知道你的数据是多少位的，也不知道你的FIR是多少阶的，如果位数宽，且阶数多的话，你的FPGA可能没有这么多的乘法器，还有不知道FPGA里面的乘法器是不是补码乘法器，如果不是的话，你的数据表示方法如果用补码的话，乘法之前要求原码，乘法器之后还要再求补码，可能得不偿失，这样的话可以考虑用原码表示整数和负数。关于补充:你的第一个问题没有提到时钟频率啊。如果你的时钟频率比采样频率高很多的话，就可以用串行的方法来做，这样的话需要很高的时钟频率，但是省资源(乘法器和加法器)，如果你没有很高的时钟，只能串行做，这种方法适用于时钟频率等于或者略大于时钟频率。硬件类一般都上硬之城看那里比较专业，专业的问题专业解决，这是最快的也是最好的方法，好过自己瞎搞，因为电子元器件的电子型号那些太多了一不小心就会弄错，所以还是找专业的帮你解决。

你最好仔细研究一下数的补码表示和运算法则。这个会告诉你完整的答案。很对。就是这样的。它有一套法则。比如1111 1111 是表示-1,你加0000 0001就变成0了，这个是正确的。但是0111 1111（+127）,你加0000 0001就成1000 0000（-128）了,这个明显不对，这就发生了溢出错误，说明位数不够。注意这些就行了。乘法复杂一些，不过也是通过各种移位，相加完成的。