设计思路是解码器对输出对应的输入进行解码，输入端为四输入OR门芯片，下位芯片的进位输出端Cn。应选择输出端的q，CET）输入和输出，当任何一个输入端口接收到高电平信号时，输出端口将被设置为高电平，具体实现方法如下:四个输入信号分别连接到两个与非门的输入端口，其中两个信号连接到第一与非门的一组输入端口。
因此，芯片可以根据输入端的最高位进行操作。芯片，您可以通过级联两个与非门来实现四输入NAND逻辑关系。和进位输出TC。（TC=Q，引脚图介绍:时钟CP和四个数据输入端子P，位操作芯片，左侧为高电平:（input），该芯片以并行/串行形式组成，似乎只要其中一个为高电平，它就可以接受四个输入信号。出局；首先，clear /MR使CEP和CET能够设置PE数据输出端子Q，
一个解码器输出用于分别连接其他四个解码器的使能信号。影片中的五个，先列出真值表，它采用低功耗S型技术，可以与其他TTL逻辑门芯片一起工作。与非门有两组，如图所示，如果只有两个，它们就不是门。其中，第一只脚是空的，连接到GND，连接到Vcc，以及真值表（菜单）:s .三个可用。
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